Tools zur Design-Verifikation

Mentor, a Siemens business, kündigt eine neue mehrdimensionale „Shift-Left“-Verifikationsplattform an. Diese automatisierte Lösung integriert innerhalb einer einzigen Authoring-Umgebung eine breite Palette einfach zu bedienender Verifikations-Tools in eine Leiterplatten-Designplattform, um Probleme frühzeitig im Design, in der Schaltplan- oder Layout-Phase, zu erkennen. Die neue Xpedition-Plattform für Mainstream-Leiterplatteningenieure bietet simultane, „auf Anhieb richtige“ Designanalyse und -verifikation sowie umfassende Tool-Integration. Damit lassen sich erhebliche Zeit- und Kosteneinsparungen bei gleichzeitiger Bereitstellung hochwertiger Produkte erzielen.

(Quelle: Mentor)

Die Verifikationsplattform Xpedition nutzt Best-Practice-Prozesse. Nicht spezialisierte Mainstream-Leiterplattendesigner erlangen damit schnell und intuitiv Simulations- und Analysefunktionen. Integrierte Verifikationstechnologien ermöglichen automatische Modellerstellung, gleichzeitige Simulation, Cross-Probing aus Ergebnissen und Fehlerüberprüfungen in einer einzigen Umgebung. Die neue Xpedition-Plattform ist die nach Anbieterangaben umfassendste mehrdimensionale Lösung für die Upfront-Designverifizierung. Sie reicht vom Konzept bis zur Übergabe des Designs und gewährleistet die Herstellbarkeit.

Die Xpedition-Plattform umfasst ein breites Spektrum an robusten Technologien: Schaltplananalyse, Signal-Integritäts- (SI) und Power-Integritäts (PI)-Analyse, Überprüfung der elektrischen Regeln (ERC), thermische Simulation, Schwingungsanalyse, Design-for-Fab (DFF), -Assembly (DFA) und -Test (DFT) sowie Prüfung der Herstellbarkeit. Diese integrierten Technologien, die in einer einzigen Authoring-Umgebung zum Einsatz kommen, die dem Designer oder Designteam vertraut ist, ermöglichen die frühe Erstellung von virtuellen Designprototypen.

Die neue Verifikationsplattform Xpedition umfasst führende Technologien in folgenden Bereichen: Design-for-Manufacturability- (DFM) Analyse Verifizierung des Schaltplanentwurfs, Design-for-Test-Analyse und Sign-off der elektrischen Leistung.

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